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Design Verification Engineer, Automotive Robotics(m/w/x)
VollzeitRemoteSenior
München
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TETenstorrent
Emulation Engineer, Automotive Robotics(m/w/x)
München
VollzeitRemoteSenior
AI/ML
Nejo KI-Zusammenfassung
Infrastructure construction for chiplet-based system validation and multi-chiplet scaling for software development. Expert-level proficiency with ZeBu, Palladium, or Veloce platforms required. Remote work model, high-performance RISC-V CPU environment.
Anforderungen
- 10+ years of SoC or ASIC experience
- Deep understanding of logic design, verification, and emulation platforms
- Fluency in Verilog, SystemVerilog, C, C++, or SystemC
- Experience with ZeBu, Palladium, or Veloce emulators
- Confidence in architecting DV and emulation environments
- Ability to automate processes
- Collaborative and self-driven nature
- Passion for mentoring junior engineers
- Ability to work cross-functionally
Aufgaben
- Build infrastructure for chiplet-based system validation
- Scale multi-chiplet emulation for software development
- Support DV and power-performance debug
- Develop testbenches, transactors, and monitors
- Enable high-quality and efficient emulation usage
- Drive functional and performance emulation coverage
- Enable and automate low-level software flows
- Optimize platforms for frequency and resource sharing
- Provide technical support for emulation end-users
- Build scalable emulation flows for SiP chiplets
- Manage AI workloads and system-level power
- Integrate AI engines and RISC-V CPUs
- Manage die-to-die links, PCIe, and UCIe
- Integrate memory controllers into unified platforms
- Align virtual prototyping and power analysis
- Develop full-stack validation solutions
- Execute cross-functional silicon bring-up strategies
- Manage RTL to post-silicon debug
Berufserfahrung
- 10 Jahre
Ausbildung
- Bachelor-AbschlussODER
- Master-Abschluss
Sprachen
- Englisch – verhandlungssicher
Tools & Technologien
- Verilog
- SystemVerilog
- C
- C++
- SystemC
- ZeBu
- Palladium
- Veloce
Benefits
Attraktive Vergütung
- Highly competitive compensation package
Flexibles Arbeiten
- Remote work
Die Originalanzeige dieses Stellenangebotes in der aktuellsten Version findest du hier. Nejo hat diesen Job automatisch von der Website des Unternehmens Tenstorrent erfasst und die Informationen auf Nejo mit Hilfe von KI für dich aufbereitet. Trotz sorgfältiger Analyse können einzelne Informationen unvollständig oder ungenau sein. Bitte prüfe immer alle Angaben in der Originalanzeige! Inhalte und Urheberrechte der Originalanzeige liegen beim ausschreibenden Unternehmen.
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Anforderungen
- 10+ years of SoC or ASIC experience
- Deep understanding of logic design, verification, and emulation platforms
- Fluency in Verilog, SystemVerilog, C, C++, or SystemC
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- Confidence in architecting DV and emulation environments
- Ability to automate processes
- Collaborative and self-driven nature
- Passion for mentoring junior engineers
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Aufgaben
- Build infrastructure for chiplet-based system validation
- Scale multi-chiplet emulation for software development
- Support DV and power-performance debug
- Develop testbenches, transactors, and monitors
- Enable high-quality and efficient emulation usage
- Drive functional and performance emulation coverage
- Enable and automate low-level software flows
- Optimize platforms for frequency and resource sharing
- Provide technical support for emulation end-users
- Build scalable emulation flows for SiP chiplets
- Manage AI workloads and system-level power
- Integrate AI engines and RISC-V CPUs
- Manage die-to-die links, PCIe, and UCIe
- Integrate memory controllers into unified platforms
- Align virtual prototyping and power analysis
- Develop full-stack validation solutions
- Execute cross-functional silicon bring-up strategies
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Berufserfahrung
- 10 Jahre
Ausbildung
- Bachelor-AbschlussODER
- Master-Abschluss
Sprachen
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Tools & Technologien
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Benefits
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Flexibles Arbeiten
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Über das Unternehmen
Tenstorrent
Branche
IT
Beschreibung
Tenstorrent leads in AI technology, revolutionizing performance, ease of use, and cost efficiency with its RISC-V CPU.
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